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ZHCSXK9A December 2024 – December 2024 BQ41Z90

ADVANCE INFORMATION

封裝選項

請參考 PDF 數(shù)據(jù)表獲取器件具體的封裝圖。

機械數(shù)據(jù) (封裝 | 引腳)

PVP|64

散熱焊盤機械數(shù)據(jù) (封裝 | 引腳)

訂購信息

zhcsxk9a_oa

6.8 通用輸入/輸出

所述典型值的條件是 T_A = 25°C 且 V_BAT = 59.2 V，最小值/最大值的條件是 T_A = -40°C 至 85°C 且 V_BAT = 5 V 至 80 V（除非另有說明）

參數(shù)		測試條件	最小值	典型值	最大值	單位
低壓 GPIO（RA 和 RC 端口）
V_IN	輸入電壓范圍	RA0..3（SDA0、SCL0、SDA1、SCL1）	-0.2		5.5	V
V_IN	輸入電壓范圍	RC0..8	-0.2		V_REG3.3	V
V_IH⁽²⁾	高電平輸入電壓	RA0..3（SDA0、SCL0、SDA1、SCL1）	0.7 x V_REGIO			V
V_IH⁽²⁾	高電平輸入電壓	RC0..8	0.7 x V_REGIO			V
V_IL⁽²⁾	低電平輸入電壓	RA0..3（SDA0、SCL0、SDA1、SCL1）			0.3 x V_REGIO	V
V_IL⁽²⁾	低電平輸入電壓	RC0..8			0.3 x V_REGIO	V
V_IOHYS⁽¹⁾	輸入遲滯	RA0..3、RC0..8	75			mV
V_OH⁽²⁾	輸出電壓高電平	RC0..8：I_OH = -450μA	0.7*V_REGIO			V
V_OL	輸出電壓低電平	RA0..3（SDA0、SCL0、SDA1、SCL1）：I_OH = 3mA			0.35	V
V_OL	輸出電壓低電平	RC0..8：I_OH = 1mA			0.35	V
t_PWMRISE	PWM 輸出上升時間	RC0、RC1：C_L = 100pF，Q_tot = 1nC，柵極驅(qū)動的 0% 至 90%，PWM_SYNC = 1			6	μs
t_PWMFALL	PWM 輸出下降時間	RC0、RC1：C_L = 100pF，Q_tot = 1nC，柵極驅(qū)動的 100% 至 10%，PWM_SYNC = 1			6	μs
R_BUSPD	內(nèi)部弱下拉電阻	RA0...3，常開	3.2	4	4.8	MΩ
R_WKPD	內(nèi)部下拉電阻	RA0...3（SDA0、SCL0、SDA1、SCL1）	35	40	50	kΩ
R_WKPD	內(nèi)部下拉電阻	RC0...8	15	20	30	kΩ
R_WKPU	內(nèi)部上拉電阻	RC0...8	180	100	120	kΩ
C_I⁽¹⁾	輸入電容	RA0...3（SDA0、SCL0、SDA1、SCL1）		1.8		pF
C_I⁽¹⁾	輸入電容	RC0...8		1.5		pF
I_lkg⁽¹⁾	輸入漏電流	RA0...3，包括常開 R_BUSPD 下拉電阻		0.5	2	μA
I_lkg⁽¹⁾	輸入漏電流	RC0...8		1	2	μA
具有 ADC 輸入的 GPIO（RADC 端口）
V_IN	輸入電壓范圍	RADCx/TS：當用作 ADC 輸入時，內(nèi)部基準 (V_REF1)	-0.2		1	V
		RADCx/TS：當用作 ADC 輸入時，外部基準 (V_REG18)	-0.2		0.8 x V_REG18	V
		無弱上拉電阻的 RADCx/TS，其中 n = 0 至 8	-0.2		5.5	V
		具有弱上拉電阻的 RADCx/TS，其中 n = 0 至 8	-0.2		V_REGIO	V
V_IH⁽²⁾	高電平輸入電壓	RADCx/TS	0.7 x V_REGIO			V
V_IL⁽²⁾	低電平輸入電壓	RADCx/TS0			0.3 x V_REGIO	V
V_IOHYS⁽¹⁾	輸入遲滯	RADCx/TS	75			mV
V_OH⁽²⁾	輸出電壓高電平	RADCx/TS：I_OH = -1mA	0.7*V_REGIO			V
V_OL⁽²⁾	輸出電壓低電平	RADCx/TS：I_OL = 3mA			0.3 x V_REGIO	V
R_WKPD	內(nèi)部弱下拉電阻	RADC0...8	0.8	1	1.2	MΩ
R_WKPU	內(nèi)部弱上拉電阻	RADC0...8	0.8	1	1.2	MΩ
C_I⁽¹⁾	輸入電容	RADC0...8		2		pF
I_lkg⁽¹⁾	輸入漏電流	RADC0...8		1	5	μA
具有電流阱的低壓 GPIO（RL/LED 端口）
V_IN	輸入電壓范圍	無弱上拉電阻	-0.2		5.5	V
V_IN⁽²⁾	輸入電壓范圍	具有弱上拉電阻	-0.2		V_REGIO	V
V_IH⁽²⁾	高電平輸入電壓		0.7*V_REGIO			V
V_IL⁽²⁾	低電平輸入電壓				0.3 x V_REGIO	V
V_IOHYS⁽¹⁾	輸入遲滯		75			mV
V_OH⁽²⁾	輸出電壓高電平	I_OH = -1mA	0.7*V_REGIO			V
I_OL	灌電流	V_OL = 1V	3.5	5	6.5	mA
R_WKPD	內(nèi)部弱下拉電阻		0.8	1	1.2	MΩ
R_WKPU	內(nèi)部弱上拉電阻		0.8	1	1.2	MΩ
C_I⁽¹⁾	輸入電容			5		pF
I_lkg⁽¹⁾	輸入漏電流			1	2	μA

(1) 根據(jù)設(shè)計確定。未經(jīng)生產(chǎn)測試。

(2) V_REGIO 可以是 1.8V 或 3.3V，具體取決于 OTP 配置。