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ZHCSYQ9 August 2025 TLIN4029A-Q1

PRODUCTION DATA

封裝選項

機械數(shù)據(jù) (封裝 | 引腳)

D|8
- MSOI002K
DRB|8
- MPDS118K

散熱焊盤機械數(shù)據(jù) (封裝 | 引腳)

DRB|8
- QFND619

訂購信息

5.7 占空比特性

參數(shù)在 -40℃ ≤ T_A ≤ 125℃ 范圍內(nèi)有效（除非另有說明）

參數(shù)		測試條件	最小值	最大值	單位
D1_12V	占空比 1（ISO 17987 參數(shù) 27）⁽³⁾	TH_REC(MAX) = 0.744 x V_SUP TH_DOM(MAX) = 0.581 x V_SUP，V_SUP = 7V 至 18V，t_BIT = 50μs (20kbps)，D1 = t_{BUS_rec(min)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）	0.396
D1_12V	占空比 1（ISO 17987 參數(shù) 27）⁽³⁾ ⁽⁴⁾	TH_REC(MAX) = 0.625 x V_SUP TH_DOM(MAX) = 0.581 x V_SUP，V_SUP = 4V 至 7V，t_BIT = 50μs (20kbps)，D1 = t_{BUS_rec(min)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）	0.396
D1	占空比 1 ⁽¹⁾ ⁽²⁾ ⁽⁴⁾	TH_REC(MAX) = 0.744 x V_SUP， TH_DOM(MAX) = 0.581 x V_SUP， V_SUP = 7V 至 18V，t_BIT = 52μs D1 = t_{BUS_rec(min)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）	0.396
D2_12V	占空比 2（ISO 17987 參數(shù) 28）⁽³⁾	TH_REC(MIN) = 0.422 x V_SUP TH_DOM(MIN) = 0.284 x V_SUP，V_SUP = 7V 至 18V，t_BIT = 50μs (20kbps)，D2 = t_{BUS_rec(MAX)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）		0.581
D2_12V	占空比 2 ⁽³⁾ ⁽⁴⁾	TH_REC(MIN) = 0.546 x V_SUP TH_DOM(MIN) = 0.4 x V_SUP，V_SUP = 4V 至 7V，t_BIT = 50μs (20kbps)，D2 = t_{BUS_rec(MAX)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）		0.581
D2	占空比 2⁽¹⁾ ⁽²⁾ ⁽⁴⁾	TH_REC(MIN) = 0.422 x V_SUP， TH_DOM(MIN) = 0.284 x V_SUP， V_SUP = 7V 至 18V，t_BIT = 52μs D2 = t_{BUS_rec(MAX)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）		0.581
D3_12V	占空比 3（ISO 17987 參數(shù) 29）⁽³⁾	TH_REC(MAX) = 0.778 x V_SUP TH_DOM(MAX) = 0.616 x V_SUP，V_SUP = 7V 至 18V，t_BIT = 96μs (10.4kbps)，D3 = t_{BUS_rec(min)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）	0.417
D3_12V	占空比 3⁽³⁾ ⁽⁴⁾	TH_REC(MAX) = 0.645 x V_SUP TH_DOM(MAX) = 0.616 x V_SUP，V_SUP = 4V 至 7V，t_BIT = 96μs (10.4kbps)，D3 = t_{BUS_rec(min)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）	0.417
D3	占空比 3 ⁽¹⁾ ⁽²⁾ ⁽⁴⁾	TH_REC(MAX) = 0.778 x V_SUP， TH_DOM(MAX) = 0.616 x V_SUP， V_SUP = 7V 至 18V，t_BIT = 96μs D3 = t_{BUS_rec(min)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）	0.417
D4_12V	占空比 4（ISO 17987 參數(shù) 30）⁽³⁾	TH_REC(MIN) = 0.389 x V_SUP TH_DOM(MIN) = 0.251 x V_SUP，V_SUP = 7V 至 18V，t_BIT = 96μs (10.4kbps)，D4 = t_{BUS_rec(MAX)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）		0.59
D4_12V	占空比 4⁽³⁾ ⁽⁴⁾	TH_REC(MIN) = 0.422 x V_SUP TH_DOM(MIN) = 0.284 x V_SUP，V_SUP = 4V 至 7V，t_BIT = 96μs (10.4kbps)，D4 = t_{BUS_rec(MAX)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）		0.59
D4	占空比 4 ⁽¹⁾ ⁽²⁾ ⁽⁴⁾	TH_REC(MIN) = 0.389 x V_SUP， TH_DOM(MIN) = 0.251 x V_SUP， V_SUP = 7V 至 18V，t_BIT = 96μs D4 = t_{BUS_rec(MAX)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）		0.59
D1_24V	占空比 1（ISO 17987 參數(shù) 72）	TH_REC(MAX) = 0.710 x V_SUP TH_DOM(MAX) = 0.544 x V_SUP，V_SUP = 15V 至 36V，t_BIT = 50μs (20kbps)，D1 = t_{BUS_rec(min)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）	0.33
D2_24V	占空比 2（ISO 17987 參數(shù) 73）	TH_REC(MIN) = 0.446 x V_SUP TH_DOM(MIN) = 0.302 x V_SUP，V_SUP = 15.6V 至 36V，t_BIT = 50μs (20kbps)，D2 = t_{BUS_rec(MAX)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）		0.642
D3_24V	占空比 3（ISO 17987 參數(shù) 74）	TH_REC(MAX) = 0.744 x V_SUP TH_DOM(MAX) = 0.581 x V_SUP，V_SUP = 7V 至 36V，t_BIT = 96μs (10.4kbps)，D3 = t_{BUS_rec(min)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）	0.386
D3_24V	占空比 ⁽⁴⁾	TH_REC(MAX) = 0.645 x V_SUP TH_DOM(MAX) = 0.581 x V_SUP，V_SUP = 4V 至 7V，t_BIT = 96μs (10.4kbps)，D3 = t_{BUS_rec(min)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）	0.386
D4_24V	占空比 4（ISO 17987 參數(shù) 75）⁽⁴⁾	TH_REC(MIN) = 0.422 x V_SUP TH_DOM(MIN) = 0.284 x V_SUP，V_SUP = 4.6V 至 36V，t_BIT = 96μs (10.4kbps)，D4 = t_{BUS_rec(MAX)}/(2 x t_BIT)（請參閱圖 6-10、圖 6-11）		0.591
D1_LB	低電量時的占空比 1 ⁽¹⁾ ⁽²⁾ ⁽⁴⁾	TH_REC(MAX) = 0.665 x V_SUP， TH_DOM(MAX) = 0.499 x V_SUP， V_SUP = 5.5V 至 7V，t_BIT = 52μs	0.396
D2_LB	低電量時的占空比 2 ⁽¹⁾ ⁽²⁾ ⁽⁴⁾	TH_REC(MAX) = 0.496 x V_SUP TH_DOM(MAX) = 0.361 x V_SUP V_SUP = 6.1V 至 7V，t_BIT = 52μs		0.581
D3_LB	低電量時的占空比 3 ⁽¹⁾ ⁽²⁾ ⁽⁴⁾	TH_REC(MAX) = 0.665 x V_SUP， TH_DOM(MAX) = 0.499 x V_SUP， V_SUP = 5.5V 至 7V，t_BIT = 96μs	0.396
D4_LB	低電量時的占空比 4 ⁽¹⁾ ⁽²⁾ ⁽⁴⁾	TH_REC(MAX) = 0.496 x V_SUP TH_DOM(MAX) = 0.361 x V_SUP V_SUP = 6.1V 至 7V，t_BIT = 96μs		0.581
Tr-d 最大值	占空比的發(fā)送器傳播延遲時序⁽¹⁾ ⁽²⁾ ⁽⁴⁾ 隱性狀態(tài)至顯性狀態(tài)	TH_REC(MAX) = 0.744 x V_SUP， TH_DOM(MAX) = 0.581 x V_SUP 7V ≤ V_SUP ≤ 18V，t_BIT = 52μs t_{REC(MAX)_D1} - t_{DOM(MIN)_D1}		10.8	μs
Td-r 最大值	占空比的發(fā)送器傳播延遲時序⁽¹⁾ ⁽²⁾ ⁽⁴⁾ 顯性狀態(tài)至隱性顯性狀態(tài)	TH_REC(MAX) = 0.422 x V_SUP， TH_DOM(MAX) = 0.284 x V_SUP 7V ≤ V_SUP ≤ 18V，t_BIT = 52μs t_{DOM(MAX)_D2} - t_{REC(MIN)_D2}		8.4	μs
Tr-d 最大值	占空比的發(fā)送器傳播延遲時序⁽¹⁾ ⁽²⁾ ⁽⁴⁾ 隱性狀態(tài)至顯性狀態(tài)	TH_REC(MAX) = 0.778 x V_SUP， TH_DOM(MAX) = 0.616 x V_SUP 7V ≤ V_SUP ≤ 18V，t_BIT = 96μs t_{REC(MAX)_D3} - t_{DOM(MIN)_D3}		15.9	μs
Td-r 最大值	占空比的發(fā)送器傳播延遲時序⁽¹⁾ ⁽²⁾ ⁽⁴⁾ 顯性狀態(tài)至隱性顯性狀態(tài)	TH_REC(MIN) = 0.389 x V_SUP， TH_DOM(MIN) = 0.251 x V_SUP 7V ≤ V_SUP ≤ 18V，t_BIT = 96μs t_{DOM(MAX)_D4} - t_{REC(MIN)_D4}		17.28	μs
Tr-d max_low	占空比的低電量發(fā)送器傳播延遲時序⁽¹⁾ ⁽²⁾ ⁽⁴⁾ 隱性狀態(tài)至顯性狀態(tài)	TH_REC(MAX) = 0.665 x V_SUP， TH_DOM(MAX) = 0.499 x V_SUP 5.5V ≤ V_SUP ≤ 7V，t_BIT = 52μs t_{REC(MAX)_low} - t_{DOM(MIN)_low}		10.8	μs
Td-r max_low	占空比的低電量發(fā)送器傳播延遲時序⁽¹⁾ ⁽²⁾ ⁽⁴⁾ 顯性狀態(tài)至隱性狀態(tài)	TH_REC(MAX) = 0.496 x V_SUP TH_DOM(MAX) = 0.361 x V_SUP 6.1V ≤ V_SUP ≤ 7V，t_BIT = 52μs t_{DOM(MAX)_low} - t_{REC(MIN)_low}		8.4	μs

(1) SAE 2602 指揮官節(jié)點負載條件：5.5nF/4kΩ 和 899pF/20kΩ

(2) SAE 2602 響應(yīng)者節(jié)點負載條件：5.5nF/875Ω 和 899pF/900Ω

(3) ISO 17987 總線負載條件（C_LINBUS、R_LINBUS）包括 1nF/1kΩ、6.8nF/660Ω、10nF/500Ω。

(4) 根據(jù)設(shè)計確定