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ADC34J2x 屬于高線性度、超低功耗、雙通道、12 位、50MSPS 至 160MSPS 模數(shù)轉換器 (ADC) 系列。 此類器件專門設計用于支持具有寬動態(tài)范圍需求且要求苛刻的高輸入頻率信號。 當 SYSREF 輸入實現(xiàn)整個系統(tǒng)同步時，時鐘輸入分頻器將給予系統(tǒng)時鐘架構設計更高的靈活性。 該器件支持 JESD204B 接口，從而減少接口線路的數(shù)量，實現(xiàn)高系統(tǒng)集成度。 JESD204B 接口是串行接口，僅通過一個差分對即可串行輸出每個 ADC 的數(shù)據。 內部鎖相環(huán) (PLL) 會將傳入的 ADC 采樣時鐘乘以 20，以獲得串行輸出各通道的 12 位數(shù)據時所使用的位時鐘。 該器件支持子類 1，接口速率高達 3.2Gbps。
| 頂層文檔 | 類型 | 標題 | 格式選項 | 下載最新的英語版本 | 日期 | |
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| * | 數(shù)據表 | ADC34J2x 具有 JESD204B 接口的四通道 12 位 50MSPS 至 160MSPS 模數(shù)轉換器 數(shù)據表 (Rev. A) | PDF | HTML | 英語版 (Rev.A) | PDF | HTML | 2015年 2月 27日 |
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DEV-ADC34J22 是一款四通道 50MSPS ADC 模塊，旨在與 Altera HSMC 標準接軌。DEV-ADC34J22 采用 TI 符合 JESD204B 標準的全新 ADC34J22 模數(shù)轉換器 (ADC)，結合使用 TI LMK04828 抖動清除器的時鐘調節(jié)功能。它可通過 TI 的 THS4541 850MHz 帶寬全差動放大器，在 2 個通道（共 4 個）中提供單端直流耦合輸入。
該模塊可提供 6 個前面板 SMA 連接器：1 個 EXT 觸發(fā)器、1 個 EXT 時鐘和 4 個模擬輸入通道，同時提供一個用于單獨時鐘生成的板載 10MHz TCXO，其 100MHz (...)
The JESD204 rapid design IP has been designed to enable FPGA engineers to achieve an accelerated path to a working JESD204 system. The IP has been architected in a way that downstream digital processing and other application logic are isolated from most of the performance- and timing-critical (...)
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| VQFN (RGZ) | 48 | Ultra Librarian |
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